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          lattice 文章 進入lattice技術社區

          FPGA助力高速未來

          • 超級高鐵技術是一種十分新潮的交通概念,它有望以其高速、低壓系統重新定義移動出行的未來。超級高鐵的核心是在密封管網絡中,乘客艙在磁懸浮和電力推進下,以超高速度行駛。確保如此復雜系統的無縫運行和安全性需要先進的控制和監控功能,而這正是FPGA的用武之地。FPGA提供無與倫比的靈活性、安全性和高性能,可處理各類復雜任務,包括管理超級高鐵網絡中的推進、導航和通信等。憑借自身的可重新編程性、行業領先的安全功能和實時數據處理能力,FPGA在優化超級高鐵運輸系統的效率和可靠性方面發揮著關鍵作用,為更快、更安全、更可持續
          • 關鍵字: FPGA  萊迪思  Lattice  Swissloop  

          PSG獨立運作拯救的是英特爾還是FPGA

          • 根據英特爾官方的公告,2024年1月1日起,可編程解決方案部門(PSG)將獨立運營,并計劃2年內開啟IPO。值得一提的是,英特爾的PSG其實就是以2015年5月達成收購協議的Altera為主體,從當年花費167億美元成為英特爾最大一筆收購,到現在要獨立運營甚至上市套現,種種操作背后蘊含了哪些原因我們不得而知,不過這筆投資的回報價值幾何也許能終見分曉。 在半導體行業,作為霸占銷售額榜首位置最久的公司,英特爾在收購方面表現得一直很積極,但從另一個角度來看,英特爾的收購交易獲得較高評價的也不多,很多交易即使計算
          • 關鍵字: 英特爾  PSG  FPGA  Altera  賽靈思  Lattice  

          看好FPGA的增長潛力,萊迪思拓展中端產品線

          • 1 FPGA市場年增7.8%,高中低三分天下據市場調查公司Scoop.market.us的數據,全球現場可編程門陣列(FPGA)市場有望在未來幾年以7.8%的復合年增長率穩步增長。2022年,FPGA市場收入為65億美元,預計2023年將增至70億美元。增長趨勢將持續下去,預計2030年收入將達到115億美元,2031年將達到124億美元,2032年將達到135億美元。2022年,小型FPGA總貢獻23億美元,中端FPGA貢獻18億美元,高端FPGA貢獻24億美元??梢?,高中低市場基本三分天下。不過,這個
          • 關鍵字: FPGA  萊迪思  Lattice  中端FPGA  

          萊迪思動態前瞻:萊迪思開發者大會即將到來

          • 備受期待的萊迪思開發者大會即將到來,萊迪思也剛剛公布了大會的全部議程。在12月5日至7日的三天時間內將舉辦一系列精彩的主題演講、知名行業專家參與的技術小組會議,以及各類精彩的演示展示。在為期3天的線上活動中,與會者將獲得寶貴的見解、提高他們的技能,并直接從多個行業的技術領導者那里了解有關人工智能(AI)、安全性、高級互連等領域的最新趨勢、機遇和可編程解決方案。來自BMW、Meta和英偉達的主題演講 在12月5日,包括Jim Anderson(總裁兼首席執行官)、Steve Douglass(首席技術官)和
          • 關鍵字: 萊迪思  萊迪思開發者大會  Lattice  

          Altera MAX10: 交通燈控制

          • 簡易交通燈:本節將向您介紹Verilog語法之中的精髓內容——狀態機,并且將利用狀態機實現十字路口的交通燈。====硬件說明與實現項目框圖====上圖為十字路口交通示意圖分之路與主路,要求如下:交通燈主路上綠燈持續15s的時間,黃燈3s的時間,紅燈10s的時間;交通燈支路上綠燈持續7s的時間, 黃燈持續3秒的時間,紅燈18秒的時間;根據上述要求,狀態機設計框架分析如下:S1:主路綠燈點亮,支路紅燈點亮,持續15s的時間;S2:主路黃燈點亮,支路紅燈點亮,持續3s的時間;S3:主路紅燈點亮,支路綠燈點亮,持
          • 關鍵字: 交通燈  狀態機  FPGA  Lattice Diamond  小腳丫  

          Lattice MXO2: 交通燈控制

          • 簡易交通燈:本節將向您介紹Verilog語法之中的精髓內容——狀態機,并且將利用狀態機實現十字路口的交通燈。硬件說明與實現項目框圖上圖為十字路口交通示意圖分之路與主路,要求如下: * 交通燈主路上綠燈持續15s的時間,黃燈3s的時間,紅燈10s的時間; * 交通燈支路上綠燈持續7s的時間, 黃燈持續3秒的時間,紅燈18秒的時間;根據上述要求,狀態機設計框架分析如下: * S1:主路綠燈點亮,支路紅燈點亮,持續15s的時間; * S2:主路黃燈點亮,支路紅燈點亮,持續3s的時間; * S3:主路紅燈點亮,支
          • 關鍵字: 交通燈  狀態機  FPGA  Lattice Diamond  小腳丫  

          Lattice MXO2: LED呼吸燈

          • 呼吸燈:本節,我們將通過脈寬調制技術來實現“呼吸燈”,實現LED的亮度由最暗逐漸增加到最亮,再逐漸變暗的過程。 脈沖寬度調制(PWM:Pulse Width Modulation),簡稱脈寬調制。它是利用微控制器的數字輸出調制實現,是對模擬電路進行控制的一種非常有效的技術,廣泛應用于測量、通信、功率控制與變換等眾多領域。硬件說明呼吸燈的設計較為簡單,我們使用12MHz的系統時鐘作為高頻信號做分頻處理,調整占空比實現PWM,通過LED燈LD1指示輸出狀態。實現原理如上圖所示,脈沖信號的周期為T,高電平脈沖寬
          • 關鍵字: 呼吸燈  FPGA  Lattice Diamond  小腳丫  

          Altera MAX10: 計時控制

          • 計時控制在之前的實驗中我們掌握了如何進行時鐘分頻、如何進行數碼管顯示與按鍵消抖的處理,那么在本節實驗之中,我們將會實現一個籃球賽場上常見的24秒計時器。====硬件說明====在之前的實驗中我們為讀者詳細介紹過小腳丫MXO2板卡上的按鍵、數碼管、LED等硬件外設,在此不再贅述。本節將實現由數碼管作為顯示模塊,按鍵作為控制信號的輸入(包含復位信號和暫停信號),Altera MAX10作為控制核心的籃球讀秒系統,實現框圖如下:====Verilog代碼====// *****************
          • 關鍵字: 計時器  FPGA  Lattice Diamond  小腳丫  

          Lattice MXO2: 計時控制

          • Warning: file_get_contents(https://www.eetree.cn/wiki/_media/%E8%AE%A1%E6%97%B6%E5%99%A8%E6%A1%86%E5%9B%BE.png?w=800&tok=0acdce): failed to open stream: HTTP request failed! HTTP/1.1 403 Forbidden in /var/www/html/www.edw.com.cn/www/rootapp/controll
          • 關鍵字: 計時器  FPGA  Lattice Diamond  小腳丫  

          Altera MAX10: 按鍵消抖

          • 按鍵消抖在之前的實驗中我們學習了如何用按鍵作為FPGA的輸入控制,在本實驗中將學習如何進行按鍵消抖,用按鍵完成更多的功能。====硬件說明====按鍵是一種常用的電子開關,電子設計中不可缺少的輸入設備。當按下時使開關導通,松開時則開關斷開,內部結構是靠金屬彈片來實現通斷。按鍵抖動的原理抖動的產生 :通常的按鍵所用的開關為機械彈性開關,當機械觸點斷開、閉合時,由于機械觸點的彈性作用,一個按鍵開關在閉合時不會馬上穩定地接通,在斷開時也不會一下子斷開。因而在閉合及斷開的瞬間均伴隨有一連串的抖動,為了不產生這種現
          • 關鍵字: 消抖  FPGA  Lattice Diamond  小腳丫  

          Lattice MXO2: 按鍵消抖

          • 按鍵消抖在之前的實驗中我們學習了如何用按鍵作為FPGA的輸入控制,在本實驗中將學習如何進行按鍵消抖,用按鍵完成更多的功能。硬件說明按鍵是一種常用的電子開關,電子設計中不可缺少的輸入設備。當按下時使開關導通,松開時則開關斷開,內部結構是靠金屬彈片來實現通斷。按鍵抖動的原理抖動的產生 :通常的按鍵所用的開關為機械彈性開關,當機械觸點斷開、閉合時,由于機械觸點的彈性作用,一個按鍵開關在閉合時不會馬上穩定地接通,在斷開時也不會一下子斷開。因而在閉合及斷開的瞬間均伴隨有一連串的抖動,為了不產生這種現象而作的措施就是
          • 關鍵字: 消抖  FPGA  Lattice Diamond  小腳丫  

          Altera MAX10: LED流水燈

          • 在時鐘分頻實驗中我們練習了如何處理時鐘,接下來我們要學習如何利用時鐘來完成時序邏輯。====硬件說明====流水燈實現是很常見的一個實驗,雖然邏輯比較簡單,但是里面也包含了實現時序邏輯的基本思想。要用FPGA實現流水燈有很多種方法,在這里我們會用兩種不同的方法實現。1,模塊化設計:在之前的實驗中我們做了3-8譯碼器和時鐘分頻,如果把這兩個結合起來,我們就能搭建一個自動操作的流水LED顯示??驁D如下:2,循環賦值:這是一種很簡潔的實現流水燈效果邏輯,就是定義一個8位的變量,在每個時鐘上升沿將最低位賦值給最高
          • 關鍵字: 流水燈  FPGA  Lattice Diamond  小腳丫  

          Lattice MXO2: LED流水燈

          • 在時鐘分頻實驗中我們練習了如何處理時鐘,接下來我們要學習如何利用時鐘來完成時序邏輯。硬件說明流水燈實現是很常見的一個實驗,雖然邏輯比較簡單,但是里面也包含了實現時序邏輯的基本思想。要用FPGA實現流水燈有很多種方法,在這里我們會用兩種不同的方法實現。1,模塊化設計:在之前的實驗中我們做了3-8譯碼器和時鐘分頻,如果把這兩個結合起來,我們就能搭建一個自動操作的流水LED顯示??驁D如下:2,循環賦值:這是一種很簡潔的實現流水燈效果邏輯,就是定義一個8位的變量,在每個時鐘上升沿將最低位賦值給最高位,其他位右移一
          • 關鍵字: 流水燈  FPGA  Lattice Diamond  小腳丫  

          Altera MAX10: 時鐘分頻

          • 時鐘分頻在之前的實驗中我們已經熟悉了小腳丫的各種外設,掌握了verilog的組合邏輯設計,接下來我們將學習時序邏輯的設計。====硬件說明====時鐘信號的處理是FPGA的特色之一,因此分頻器也是FPGA設計中使用頻率非常高的基本設計之一。一般在FPGA中都有集成的鎖相環可以實現各種時鐘的分頻和倍頻設計,但是通過語言設計進行時鐘分頻是最基本的訓練,在對時鐘要求不高的設計時也能節省鎖相環資源。在本實驗中我們將實現任意整數的分頻器,分頻的時鐘保持50%占空比。1,偶數分頻:偶數倍分頻相對簡單,比較容易理解。通
          • 關鍵字: 時序邏輯  時鐘分頻  FPGA  Lattice Diamond  小腳丫  

          Lattice MXO2: 時鐘分頻

          • 時鐘分頻在之前的實驗中我們已經熟悉了小腳丫的各種外設,掌握了verilog的組合邏輯設計,接下來我們將學習時序邏輯的設計。硬件說明時鐘信號的處理是FPGA的特色之一,因此分頻器也是FPGA設計中使用頻率非常高的基本設計之一。一般在FPGA中都有集成的鎖相環可以實現各種時鐘的分頻和倍頻設計,但是通過語言設計進行時鐘分頻是最基本的訓練,在對時鐘要求不高的設計時也能節省鎖相環資源。在本實驗中我們將實現任意整數的分頻器,分頻的時鐘保持50%占空比。1,偶數分頻:偶數倍分頻相對簡單,比較容易理解。通過計數器計數是完
          • 關鍵字: 時序邏輯  時鐘分頻  FPGA  Lattice Diamond  小腳丫  
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          lattice介紹

            萊迪思(Lattice)半導體公司提供業界最廣范圍的現場可編程門陣列(FPGA)、可編程邏輯器件(PLD)及其相關軟件,包括現場可編程系統芯片(FPSC)、復雜的可編程邏輯器件(CPLD),可編程混合信號產品(ispPAC?)和可編程數字互連器件(ispGDX?)。萊迪思還提供業界領先的SERDES產品。 FPGA和PLD是廣泛使用的半導體元件,最終用戶可以將其配置成特定的邏輯電路,從而縮短設 [ 查看詳細 ]

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